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Funktionsbeschreibung der Bridgetek BT81X (815/6) Advanced Embedded Video Engine

May 09, 2019

Der BT815 / 6 ist ein Embedded-Video-Controller mit einem Chip und den folgenden Funktionsblöcken:

 Quad-SPI-Host-Schnittstelle

 Quad-SPI-Flash-Schnittstelle

 Systemuhr

 Grafikmodul

 Parallele RGB-Videoschnittstelle

 Audio Engine

 Touchscreen-Unterstützung und Schnittstelle (Resistive = BT816 / Capacitive - BT815)

 Energieverwaltung


Die Funktionen für jeden Block werden in den folgenden Unterabschnitten kurz beschrieben.


4.1 Quad-SPI-Host-Schnittstelle

Das BT815 / 6 verwendet eine vierfach serielle Peripherieschnittstelle (QSPI) zur Kommunikation mit Host-Mikrocontrollern
und Mikroprozessoren.


4.1.1 QSPI-Schnittstelle

Die QSPI-Slave-Schnittstelle arbeitet mit bis zu 30 MHz. Es wird nur der SPI-Modus 0 unterstützt. Siehe Abschnitt 6.4.2 für
detaillierte Timing-Spezifikation. Das QSPI kann als SPI-Slave in SINGLE, DUAL oder QUAD konfiguriert werden
Kanalmodi.
Standardmäßig arbeitet der SPI-Slave im SINGLE-Channel-Modus mit MOSI als Eingang vom Master und
MISO als Ausgabe an den Master. Die DUAL- und QUAD-Kanalmodi können über den SPI-Slave konfiguriert werden
selbst. Um die Kanalmodi zu ändern, schreiben Sie in das Register REG_SPI_WIDTH. Die folgende Tabelle zeigt die
Rahmen.
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In den DUAL / QUAD-Kanalmodi sind die SPI-Datenports jetzt unidirektional. In diesen Modi kann jeder SPI
Die Transaktion (angezeigt, wenn CS_N auf "low" geht) beginnt mit den als Eingaben festgelegten Datenports.
Für das Schreiben auf den BT815 / 6 wird das Protokoll daher wie in FT800 mit „WR-Command / Addr2,
Addr1, Addr0, DataX, DataY, DataZ… ”Der Schreibvorgang wird als abgeschlossen betrachtet, wenn CS_N ausgeführt wird
inaktiv hoch.
Zum Lesen vom BT815 / 6 funktioniert das Protokoll weiterhin wie im FT800 mit „RD-Befehl / Adr2,
Addr1, Addr0, Dummy-Byte, DataX, DataY, DataZ ”. Da die Datenports jetzt unidirektional sind, a
Die Richtung des Ports wird geändert, bevor DataX vom BT815 / 6 aus getaktet wird. Deshalb ist es wichtig
dass die Firmware, die den SPI-Master steuert, die Richtung des SPI-Master-Datenports danach auf „Eingabe“ ändert
Übertragen von Addr0. Das BT815 / 6 ändert die Anschlussrichtung erst, wenn es beginnt, DataX auszutakten. Daher,
Die Dummy-Byte-Zyklen werden als Umschaltperiode verwendet, wenn weder der SPI-Master noch der Slave dies tun
den Bus fahren; Die Datenpfade müssen daher Pull-Ups / Pull-Downs aufweisen. Der SPI-Slave aus dem BT815 / 6
setzt die Richtung aller Datenports auf den Eingang zurück, sobald CS_N inaktiv wird (dh am Ende des Stroms)
SPI-Master-Transaktion).
Das Diagramm zeigt das Verhalten von SPI-Master und -Slave im Master-Lesefall.
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Im DUAL-Kanalmodus werden MISO (MSB) und MOSI im QUAD-Kanalmodus verwendet. IO3
(MSB), IO2, MISO und MOSI werden verwendet.
Abbildung 4-2 zeigt eine direkte Verbindung zu einer 1.8-3.3V IO MPU / MCU mit Single- oder Dual-SPI-Schnittstelle.
Abbildung 4-3 zeigt eine direkte Verbindung zu einer 1.8-3.3V IO MPU / MCU mit Quad SPI-Schnittstelle.
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4.1.2 Serielles Datenprotokoll

Das BT815 / 6 erscheint der Host-MPU / MCU als ein SPI-Gerät mit Speicherzuordnung. Der Host kommuniziert
Beim BT815 / 6 werden Lese- und Schreibvorgänge in einen großen Adressraum (4 MB) ausgeführt. Innerhalb dieser Adresse
Raum sind dedizierte Bereiche für Grafik, Audio und Touch-Steuerung. Ausführliche Informationen finden Sie in Abschnitt 5
Speicherkarte.
Der Host liest und schreibt den BT815 / 6-Adressraum mithilfe von SPI-Transaktionen. Diese Transaktionen sind
Speicher lesen, Speicher schreiben und Befehl schreiben. Serielle Daten werden mit dem höchstwertigen Bit zuerst gesendet.
Jede Transaktion, die mit CS_N beginnt, geht nach unten und endet, wenn CS_N nach oben geht. Es gibt keine Datenbeschränkung
Länge innerhalb einer Transaktion, solange die Speicheradresse fortlaufend ist.


4.1.3 Hostspeicher lesen

Bei SPI-Speicherlesetransaktionen sendet der Host zwei Null-Bits, gefolgt von der 22-Bit-Adresse. Das ist
gefolgt von einem Dummy-Byte. Nach dem Dummy-Byte antwortet der BT815 / 6 auf jedes Host-Byte mit read
Datenbytes.

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4.1.4 Hostspeicher schreiben

Bei SPI-Speicherschreibtransaktionen sendet der Host ein 1-Bit und ein 0-Bit, gefolgt von der 22-Bit-Adresse.
Darauf folgen die Schreibdaten.

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4.1.5 Host-Befehl

Beim Senden eines Befehls sendet der Host einen 3-Byte-Befehl. Tabelle 4-5 Host- Befehlslistenfehler!
Referenzquelle nicht gefunden. listet alle Host-Befehlsfunktionen auf.
Bei SPI-Befehlstransaktionen sendet der Host ein 0-Bit und ein 1-Bit, gefolgt vom 6-Bit-Befehlscode.
Das 2. Byte kann entweder 00h oder der Parameter dieses Befehls sein. Das 3. Byte ist fest auf 00h eingestellt.
Alle SPI-Befehle mit Ausnahme des Systemresets können nur ausgeführt werden, wenn sich der SPI im Einzelkanal befindet
Modus. Sie werden ignoriert, wenn sich der SPI im Dual- oder Quad-Channel-Modus befindet.
Einige Befehle werden zum Konfigurieren des Geräts verwendet und diese Konfigurationen werden beim Empfang zurückgesetzt
den Befehl SPI PWRDOWN, mit Ausnahme derer, die den Pin-Status beim Ausschalten konfigurieren. Diese
Befehle bleiben erhalten, es sei denn, sie werden neu konfiguriert oder es erfolgt ein Power-On-Reset (POR).

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Hinweis: Jeder nicht angegebene Befehlscode ist reserviert und sollte nicht von der Software verwendet werden.